Titre : |
Conception et implémentation d’un Filtre Numérique pour un signal ECG en utilisant le couple FPGA/VHDL |
Type de document : |
texte imprimé |
Auteurs : |
Razika RASLAIN, Auteur ; Sara HECHAICHI, Auteur ; Salim Ziani, Directeur de thèse |
Editeur : |
CONSTANTINE [ALGERIE] : Université Frères Mentouri Constantine |
Année de publication : |
2021 |
Importance : |
66 f. |
Format : |
30 cm. |
Note générale : |
Une copie electronique PDF disponible au BUC |
Langues : |
Français (fre) |
Catégories : |
Sciences de la technologie:Electronique
|
Tags : |
ECG FPGA/VHDL |
Index. décimale : |
610 Electronique |
Résumé : |
es circuits programmables ont beaucoup attiré l'attention par leurs propriétés
multiples.
Les outils d'aide à la conception se sont unifiés contribuant ainsi à l'essor de telles
technologies.
Nous avons étudié de manière approfondie l'électrocardiogramme (ECG) comme l'un
des outils les plus importants de la pratique clinique, afin d'évaluer l'état cardiaque des
patients, à l'aide d'électrodes placées à la surface du corps. Il permet de détecter, coordonner,
traiter, visualiser les différences d'activités électriques du cœur en fonction du temps.Souvent
,dans les machines médicales(ECG,EEG…)le traitement numérique (MP,FPGA) de
l’information nécessite la conversion analogique numérique et numérique analogique ,ces
trois fonction (ADC_fct1 ,FIR_fct2,DAC_fct3) sont exécutés dans l’ordre CNA ,traitement,
CAN.
En général, pour implémenter un CAN et un CNA dans un système de filtrage d’un
signal ECG, le couple VHDL/FPGA est l’un des outils les plus intéressé par les chercheurs
.Ceux-ci grâce à sa Simplicité, rapidité, efficacité de programmation et d'implémentation
d'une contribution ou d'améliorer les performances des systèmes. L'architecture en langage
VHDL a deux modes de conception Concurrentielle et/ou séquentielle utilisées selon le
besoin ou la nécessité ou le choix. Jusqu'à présent l'objectif principal des chercheurs: est
d'implémenter leurs conceptions sur un FPGA en utilisant une architecture séquentielle simple
sans optimisé le fonctionnement de ces architectures (conceptions) notamment le temps de
calcul.
La conception architecturelle du code à implémenter sur un FPGA est composée de
trois fonctions principales usuelles : en commençant par la fonction de la conversion parallèle
ADC_fct1 (étape de parallélisations : conversion des données sérielles vers des données
parallèles) puis la fonction de traitement FIR_fct2 (dans notre choix) en se termine par la
fonction de la conversion sérielle DAC_fct3 (étape de sérialisation : conversion des données
parallèles vers des données sérielles). Dans ce mémoire nous avons proposé cinq architectures
pour filtrer un signal ECG issu d’une carte réalisée. Le concept architecturelle pour élaborer
ces cinq architectures est basé sur le mode d’exécution, temps d’exécution et la
synchronisation entre les différentes components de la conception.Chaque architecture est
basée sur le principe que les fonctions fct1 et fct3 nécessitent un mode séquentiel et de durée |
Diplome : |
Master 2 |
Permalink : |
https://bu.umc.edu.dz/master/index.php?lvl=notice_display&id=15682 |
Conception et implémentation d’un Filtre Numérique pour un signal ECG en utilisant le couple FPGA/VHDL [texte imprimé] / Razika RASLAIN, Auteur ; Sara HECHAICHI, Auteur ; Salim Ziani, Directeur de thèse . - CONSTANTINE [ALGERIE] : Université Frères Mentouri Constantine, 2021 . - 66 f. ; 30 cm. Une copie electronique PDF disponible au BUC Langues : Français ( fre)
Catégories : |
Sciences de la technologie:Electronique
|
Tags : |
ECG FPGA/VHDL |
Index. décimale : |
610 Electronique |
Résumé : |
es circuits programmables ont beaucoup attiré l'attention par leurs propriétés
multiples.
Les outils d'aide à la conception se sont unifiés contribuant ainsi à l'essor de telles
technologies.
Nous avons étudié de manière approfondie l'électrocardiogramme (ECG) comme l'un
des outils les plus importants de la pratique clinique, afin d'évaluer l'état cardiaque des
patients, à l'aide d'électrodes placées à la surface du corps. Il permet de détecter, coordonner,
traiter, visualiser les différences d'activités électriques du cœur en fonction du temps.Souvent
,dans les machines médicales(ECG,EEG…)le traitement numérique (MP,FPGA) de
l’information nécessite la conversion analogique numérique et numérique analogique ,ces
trois fonction (ADC_fct1 ,FIR_fct2,DAC_fct3) sont exécutés dans l’ordre CNA ,traitement,
CAN.
En général, pour implémenter un CAN et un CNA dans un système de filtrage d’un
signal ECG, le couple VHDL/FPGA est l’un des outils les plus intéressé par les chercheurs
.Ceux-ci grâce à sa Simplicité, rapidité, efficacité de programmation et d'implémentation
d'une contribution ou d'améliorer les performances des systèmes. L'architecture en langage
VHDL a deux modes de conception Concurrentielle et/ou séquentielle utilisées selon le
besoin ou la nécessité ou le choix. Jusqu'à présent l'objectif principal des chercheurs: est
d'implémenter leurs conceptions sur un FPGA en utilisant une architecture séquentielle simple
sans optimisé le fonctionnement de ces architectures (conceptions) notamment le temps de
calcul.
La conception architecturelle du code à implémenter sur un FPGA est composée de
trois fonctions principales usuelles : en commençant par la fonction de la conversion parallèle
ADC_fct1 (étape de parallélisations : conversion des données sérielles vers des données
parallèles) puis la fonction de traitement FIR_fct2 (dans notre choix) en se termine par la
fonction de la conversion sérielle DAC_fct3 (étape de sérialisation : conversion des données
parallèles vers des données sérielles). Dans ce mémoire nous avons proposé cinq architectures
pour filtrer un signal ECG issu d’une carte réalisée. Le concept architecturelle pour élaborer
ces cinq architectures est basé sur le mode d’exécution, temps d’exécution et la
synchronisation entre les différentes components de la conception.Chaque architecture est
basée sur le principe que les fonctions fct1 et fct3 nécessitent un mode séquentiel et de durée |
Diplome : |
Master 2 |
Permalink : |
https://bu.umc.edu.dz/master/index.php?lvl=notice_display&id=15682 |
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